Verilog HDL을 이용한 디지털 시스템 설계 및 실습

PART 01 Verilog HDL 문법
Chapter 01 Verilog HDL 개요
Chapter 02 자료형과 연산자
Chapter 03 게이트 수준 모델링
Chapter 04 할당문
Chapter 05 행위수준 모델링
Chapter 06 구조적 모델링
Chapter 07 Tsk와 함수
Chapter 08 컴파일러 지시어
Chapter 09 시스템 task와 시스템 함수

PART 02 Verilog HDL 을 이용한 하드웨어 모델링
Chapter 10 조합논리회로 모델링
Chapter 11 순차회로 모델링

PART 03 FPGA 구현 실습
Chapter 12 EPGA 구현 실습장비
Chapter 13 Xilinx ISE 를 이용한 설계 구현
Chapter 14 Altera Quartus II 를 이용한 설계 구현
Chapter 15 조합논리회로 설계 및 구현 실습
Chapter 16 순차논리회로 설계 및 구현 실습

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참고문헌